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1 Prof. Dr. José Antonio de Frutos Redondo Curso 2013-2014 GRADO EN INGENIERÍA DE COMPUTADORES Arquitectura e Ingeniería de Computadores Arquitecturas Paralelas © J. A. de Frutos Redondo 2013 Arquitectura e Ingeniería de Computadores 1. Arquitecturas paralelas 2 Tema 4. Arquitecturas Paralelas Arquitecturas paralelas. Características de los supercomputadores actuales. Arquitecturas paralelas. Memoria compartida. SMP DSM Coherencia en memoria cache. Multicomputadores. Redes de interconexión. Interconexión de sistemas paralelos. Redes de interconexión estáticas. Redes de interconexión dinámicas.

GRADO EN INGENIERÍA DE COMPUTADORESatc2.aut.uah.es/~frutos/areinco/pdf/ArquiPARALELAS.pdf · MPP: Massively Parallel Processor. Típicamente el número de procesadores es superior

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Prof. Dr. José Antonio de Frutos Redondo Curso 2013-2014

GRADO EN INGENIERÍA DE COMPUTADORES Arquitectura e Ingeniería de Computadores

Departamento de Automática Arquitecturas Paralelas

© J. A. de Frutos Redondo 2013

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1. Arquitecturas paralelas 2

Tema 4. Arquitecturas Paralelas

n  Arquitecturas paralelas. n  Características de los supercomputadores actuales. n  Arquitecturas paralelas. n  Memoria compartida.

n  SMP n  DSM n  Coherencia en memoria cache.

n  Multicomputadores. n  Redes de interconexión.

n  Interconexión de sistemas paralelos. n  Redes de interconexión estáticas. n  Redes de interconexión dinámicas.

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1. Arquitecturas paralelas 3

Características de los supercomputadores actuales

n  Comparativa Vectoriales-MPP

LINPACK (GFLOPS)

"CRAY peak"MPP peak

Xmp /416(4)

Ymp/832(8) nCUBE/2(1024)iPSC/860

CM-2CM-200

Delta

Paragon XP/S

C90(16)

CM-5

ASCI Red

T932(32)

T3D

Paragon XP/S MP(1024)

Paragon XP/S MP(6768)

0.1

1

10

100

1,000

10,000

1985 1987 1989 1991 1993 1995 1996

Cray vectoriales (paralelos) :

X-MP (2-4) Y-MP (8) C-90 (16) T94 (32) Desde 1993,

Cray produce también MPP (T3D, T3E)

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1. Arquitecturas paralelas 4

Lista TOP500 de los computadores más rápidos

Num

ber o

f sys

tem

s

11/93 11/94 11/95 11/96 0

50

100

150

200

250

300

350

PVP MPP

SMP

319

106

284

239

63

187

313

198

110

106 73

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 5

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 6

n  SMP: Symmetric Multiprocessor. n  MPP: Massively Parallel Processor. Típicamente el número

de procesadores es superior a 100. n  Cluster: Conjunto de computadores completos conectados

por una red comercial. n  Cluster Beowulf: Cluster de sistema operativo libre y

componentes comerciales ordinarios. n  Constellation: Cluster de nodos donde cada uno de ellos es

de tipo SMP. n  Grid: Colección de recursos autónomos geográficamente

distribuidos, acoplados mediante la infraestructura de comunicaciones, y débilmente acoplados.

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 7

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 8

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 9

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 10

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1. Arquitecturas paralelas 11

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 12

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1. Arquitecturas paralelas 13

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1. Arquitecturas paralelas 14

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 15

Características de los supercomputadores actuales

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1. Arquitecturas paralelas 16

n  Caracterización de la Arquitectura. n  ANTES: Conjunto de instrucciones. n  AHORA: Comunicaciones.

n  Podemos decir que la “Arquitectura Paralela” es: n  Arquitectura convencional

+ n  Arquitectura de comunicación

Arquitecturas Paralelas

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1. Arquitecturas paralelas 17

Arquitecturas Paralelas

Arquitectura de comunicación n  User/System Interface + Implementación

n  User/System Interface: n  Primitivas de comunicación a nivel de usuario y a nivel de sistema.

n  Implementación: n  Estructuras que implementan las primitivas: hardware o OS n  Capacidades de optimización. Integración en los nodos de proceso. n  Estructura de la red.

n  Objetivos: n  Rendimiento n  Amplia aplicación n  Fácil programación n  Ampliable n  Bajo coste

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1. Arquitecturas paralelas 18

Modelos de programación n  Especifica las comunicaciones y la sincronización. n  Ejemplos:

n  Multiprogramación: no hay comunicación o sincronismo. Paralelismo a nivel de programa.

n  Memoria compartida: como un tablón de anuncios. n  Paso de mensajes: como cartas o llamadas telefónicas, punto a

punto. n  Paralelismo de datos: varios agentes actúan sobre datos

individuales y luego intercambian información de control antes de seguir el proceso.

n  El intercambio se implementa con memoria compartida o con paso de mensajes.

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1. Arquitecturas paralelas 19

CAD

Multiprogramming Shared address

Message passing

Data parallel

Database Scientific modeling Parallel applications

Programming models

Communication abstraction User/system boundary

Compilation or library

Operating systems support

Communication hardware

Physical communication medium

Hardware/software boundary

Arquitecturas Paralelas

n  Niveles de abstracción en la comunicación

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1. Arquitecturas paralelas 20

Memoria Compartida

n  Cualquier procesador puede referenciar directamente cualquier posición de memoria.

n  La comunicación se realiza implícitamente por medio de cargas y almacenamientos.

n  Tipos: n  Symmetric multiprocessors (SMP). n  Distributed shared memory (DSM).

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1. Arquitecturas paralelas 21

Memoria Compartida

n  Symmetric multiprocessors (SMP) n  Pequeño número de cores. n  Memoria compartida con acceso uniforme (UMA).

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1. Arquitecturas paralelas 22

Memoria Compartida

n  Distributed shared memory (DSM) n  Memoria distribuida entre los procesadores. n  Latencia de acceso no uniforme (NUMA).

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1. Arquitecturas paralelas 23

Coherencia en Memoria Cache

Estructuras comunes de la jerarquía de memoria en

multiprocesadores

n  Memoria cache compartida. n  Memoria compartida mediante bus. n  Interconexión por medio de red (dance-hall) n  Memoria distribuida.

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1. Arquitecturas paralelas 24

Coherencia en Memoria Cache

P1 Pn

Memoria principal (Entrelazada)

Memoria cache (Entrelazada)

Cache compartida n  Pequeño número de

procesadores (2-8) n  Fue común a mediados

de los 80 para conectar un par de procesadores en placa.

n  Posible estrategia en chip multiprocesadores.

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1. Arquitecturas paralelas 25

Compartición por medio de bus.

n  Ampliamente usada en multiprocesadores de pequeña y mediana escala (20-30)

n  Forma dominante en las máquinas paralelas actuales.

n  Los microprocesadores modernos están dotados para soportar protocolos de coherencia en esta configuración.

P1 Pn

Memoria principal

Memoria cache

Memoria cache

bus

Coherencia en Memoria Cache

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1. Arquitecturas paralelas 26

Salón de baile n  Fácilmente escalable. n  Estructura simétrica

UMA. n  Memoria demasiado

lejana especialmente en grandes sistemas.

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Memoria principal

Memoria cache

Memoria cache

Red de interconexión

Memoria principal

Coherencia en Memoria Cache

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1. Arquitecturas paralelas 27

Pn

Memoria cache Memoria

principal

Red de interconexión

P1

Memoria cache Memoria

principal

Coherencia en Memoria Cache

Memoria distribuida • Especialmente atractiva par multiprocesadores escalables. • Estructura no simétrica NUMA. • Accesos locales rápidos.

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1. Arquitecturas paralelas 28

El problema de la coherencia n  Datos actualizados en memoria principal y las caches

particulares. n  Monoprocesadores:

n  Incoherencia en distintos niveles. n  Operaciones de I/O.

n  Multiprocesadores: n  Incoherencia en distintos niveles n  Incoherencia en el mismo nivel

Coherencia en Memoria Cache

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1. Arquitecturas paralelas 29

Fuentes de incoherencia: n  Los datos compartidos. n  La migración de procesos. n  Las operaciones de entrada-salida.

Fuentes de incoherencia

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1. Arquitecturas paralelas 30

P0 P1 P2 Pn

Memoria principal

Memoria cache

Datos compartidos en caches de escritura directa.

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1. Arquitecturas paralelas 31

Memoria principal

P0 P1 P2 Pn

Memoria cache

Datos compartidos en caches de post-escritura.

Fuentes de incoherencia

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1. Arquitecturas paralelas 32

P0 P1 P2 Pn

Memoria principal

Memoria cache

P2 P0

Migración de procesos en caches de escritura directa.

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1. Arquitecturas paralelas 33

P0 P1 P2 Pn

Memoria principal

Memoria cache

P2 P0

Migración de procesos en caches de post-escritura.

Fuentes de incoherencia

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1. Arquitecturas paralelas 34

Operaciones de entrada salida

Salida (post-escritura)

Memoria principal

Memoria cache

P0 P1 P2 Pn

Entrada

Fuentes de incoherencia

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1. Arquitecturas paralelas 35

Posibles soluciones

n  Caches locales. n  Memoria cache compartida. n  Caches privadas con protocolos de escucha. n  Caches privadas con directorio compartido.

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1. Arquitecturas paralelas 36

P

X

P

X

P

X

P

X

X

P

X'

P

I

P

I

P

I

X'

P

X'

P

X'

P

X'

P

X'

X'

Invalidar Actualizar

n  Políticas de mantenimiento de coherencia n  Invalidar. n  Actualizar.

Fuentes de incoherencia

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1. Arquitecturas paralelas 37

Protocolos de escucha

Protocolos snoopy n  Sistemas de memoria basados en bus. n  Escucha de las operaciones (snoop) n  Se deben transmitir las operaciones de lectura y escritura. n  Las operaciones de cambio de bloque no influyen en el

estado del bloque en otros procesadores.

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1. Arquitecturas paralelas 38

Protocolos snoopy Caches de escritura directa.

inválido válido R(j) W(j)

R(i), W(i)

W(j)

R(j) W(i)

R(i)

Protocolos de escucha

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1. Arquitecturas paralelas 39

R(i) R(j)

R(j), W(j)

M S

I

R(j)

W(i) R(i) W(i)

W(j)

W(i)

W(j)

R(i)

Protocolos snoopy Caches de post-escritura MSI.

Protocolos de escucha

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1. Arquitecturas paralelas 40

W(j) R(j)

R(i) S

R(i) R(j)

W(i) W(j) R(j)

R(i) R(i) W(i) M E

S I

W(j)

R(i) S

W(i)

W(j)

R(j) S

W(i)

Protocolos snoopy Caches de post-escritura MESI.

Protocolos de escucha

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1. Arquitecturas paralelas 41

Protocolos basados en directorios n  Multiprocesadores con red de interconexión. n  Dificultades de broadcast y su escalabilidad. n  Directorio: guarda la información relativa al estado del bloque

de cache. n  Directorios centralizados y directorios distribuidos.

Protocolos basados en directorios

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1. Arquitecturas paralelas 42

Fallo de lectura en estado modificado.

Directorio

P1

Cache Bloque Mem.

Directorio

P2

Cache Bloque Mem.

Directorio

P3

Cache Bloque Mem.

Protocolos basados en directorios

1

2

3

4

4

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1. Arquitecturas paralelas 43

Fallo de escritura en estado compartido.

Directorio

P1

Cache Bloque Mem. Directorio

P2

Cache Bloque Mem.

Directorio

P3

Cache Bloque Mem.

Directorio

P4

Cache Bloque Mem.

Protocolos basados en directorios

4 4

3 3

1

2

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1. Arquitecturas paralelas 44

bloque 1 0 1 0

Directorio

P

Cache Bloque Mem.

0

P0 P1 Pm P2 Dirty

Estructura del directorio (directorios completos)

Protocolos basados en directorios

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1. Arquitecturas paralelas 45

Estructura del directorio (directorios limitados)

bloque

Directorio

P

Cache Bloque Mem.

0

I1 In I2 Dirty

log2 P

Protocolos basados en directorios

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1. Arquitecturas paralelas 46

Estructura del directorio (directorios encadenados)

bloque Directorio

P

Cache Bloque Mem. 0

P Dirty

log2 P

Directorio

P

Cache Bloque Mem.

Directorio

P

Cache Bloque Mem.

Directorio

P

Cache Bloque Mem.

FC FC FC

Protocolos basados en directorios

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1. Arquitecturas paralelas 47

Multicomputadores

n Sistemas compuestas por la interconexión de computadores completos (CPU, memoria, I/O)

n Mapas de memoria disjuntos. n Comunicación por paso de mensajes.

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1. Arquitecturas paralelas 48

Memory bus

MicroChannel bus

I/O

i860 NI

DMA

DRAM

IBM SP-2 node

L2 $

Power 2CPU

Memorycontroller

4-wayinterleaved

DRAM

General inter connectionnetwork formed fr om8-port switches

NIC

Ejemplo: IBM SP-2

n  Realizado a base de estaciones RS6000.

Multicomputadores

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1. Arquitecturas paralelas 49

Memory bus (64-bit, 50 MHz)

i860

L1 $

NI

DMA

i860

L1 $

Driver

Memctrl

4-wayinterleaved

DRAM

IntelParagonnode

8 bits,175 MHz,bidirectional2D grid network

with processing nodeattached to every switch

Sandia’ s Intel Paragon XP/S-based Super computer

Ejemplo Intel Paragon.

Multicomputadores

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1. Arquitecturas paralelas 50

Interconexión de sistemas paralelos

n  La misión de la red en una arquitectura paralela es transferir información desde cualquier fuente a cualquier destino minimizando la latencia y con coste proporcionado.

n  La red se compone de: n  nodos; n  conmutadores; n  enlaces.

n  La red se caracteriza por su: n  topología: estructura de la interconexión física; n  enrutado: que determina las rutas que los mensajes pueden o

deben seguir en el grafo de la red; n  estrategia de conmutación: de circuitos o de paquetes; n  control de flujo: mecanismos de organización del tráfico.

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1. Arquitecturas paralelas 51

n  Clasificación de las redes por su topología. n  Estáticas:

n  conexiones directas estáticas punto a punto entre los nodos; n  fuerte acoplamiento interfaz de red-nodo; n  los vértices del grafo de la red son nodos o conmutadores; n  se clasifican a su vez:

n  simétricas: anillo, hipercubo, toro; n  no simétricas: bus, árbol, malla.

Interconexión de sistemas paralelos

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1. Arquitecturas paralelas 52

n  Clasificación de las redes por su topología. n  Dinámicas:

n  los conmutadores pueden variar dinámicamente los nodos que interconectan.

n  Se clasifican a su vez: n  monoetapa; n  multietapa:

n  bloqueante (línea base, mariposa, baraje); n  reconfigurable (Beneš); n  no bloqueante (Clos).

Interconexión de sistemas paralelos

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1. Arquitecturas paralelas 53

n  Parámetros característicos de una red: n  Tamaño de la red: número de nodos que la componen.

n  Grado de un nodo: número de enlaces que inciden en el nodo.

n  Diámetro de la red: es el camino mínimo más largo que se puede encontrar entre dos nodos cualesquiera de la red.

n  Simetría: una red es simétrica si todos los nodos son indistinguibles desde el punto de vista de la comunicación.

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1. Arquitecturas paralelas 54

Red lineal

Anillo Estrella

Arbol Malla Red sistólica

Totalmente conexa Anillo cordalCubo-3

Redes estáticas

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1. Arquitecturas paralelas 55

Tipo de red grado diámetro enlaces simetría lineal 2 N − 1 N − 1 no

anillo 2 N/2 N sí

totalmente conexa N − 1 1 N(N − 1)/2 sí

arbol (h = log2 N + 1) 3 2(h − 1) N − 1 no

estrella N − 1 2 N − 1 no

malla - 2D (r x r) 4 2(r − 1) 2N − 2r no

hipercubo n n n nN/2 sí

Redes estáticas

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ompu

tado

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1. Arquitecturas paralelas 56

Hipercubo 3D ciclo-conexo

Redes estáticas

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1. Arquitecturas paralelas 57

000 001

010 011

101

111110

100

000 010001 011 100 110101 111

Conexión de nodos que se diferencian en el bit menos significativo

Conexión de nodos que se diferencian en el segundo bit

000 010001 011 100 110101 111

Conexión de nodos que se diferencian en el bit más significativo

000 010001 011 100 110101 111

Ejemplo de conexiones en un hipercubo 3

Redes estáticas

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1. Arquitecturas paralelas 58

n  Redes dinámicas: son redes cuya configuración puede modificarse. Hay dos tipos: n  monoetapa. n  multietapa.

n  Las redes monoetapa realizan conexiones entre elementos de proceso en una sola etapa. n  Puede que no sea posible llegar desde cualquier elemento a

cualquier otro, por lo que puede ser necesario recircular la información (=>redes recirculantes)

n  Las redes multietapa realizan conexiones entre los elementos de proceso en más de una etapa.

Redes dinámicas

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1. Arquitecturas paralelas 59

Redes de interconexión monoetapa

Redes dinámicas

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1. Arquitecturas paralelas 60

EP0

EP1

EPn

EP0 EP1 EPn

EP0

EP1

EPn

M0 M1 Mm

Red de barras cruzadas: permite cualquier conexión.

Redes dinámicas

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1. Arquitecturas paralelas 61

Redes de interconexión (multietapa)

Las cuatro configuraciones posibles de una caja de conmutación de 2 entradas.

Cajas de conmutación

a 0

a 1

b 0

b 1

a 0

a 1

b 0

b 1

a 0

a 1

b 0

b 1

a 0

a 1

b 0

b 1

Paso directo Cruce

Difusión superiorDifusión inferior

Redes dinámicas

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1. Arquitecturas paralelas 62

n  Redes multietapa bloqueantes. n  Se caracterizan porque no es posible establecer siempre una

nueva conexión entre un par fuente/destino libres, debido a conflictos con las conexiones en curso.

n  Generalmente existe un único camino posible entre cada par fuente/destino.

Redes dinámicas

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1. Arquitecturas paralelas 63

n  Red de línea base:

Red de línea base 8 x 8

Redes dinámicas

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1. Arquitecturas paralelas 64

n  Red mariposa:

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1. Arquitecturas paralelas 65

n  Red baraje perfecto:

000

001

010

011

100

101

110

111

000

001

010

011

100

101

110

111

Barajado perfecto

000

001

010

011

100

101

110

111

000

001

010

011

100

101

110

111

Barajado perfecto inverso

Redes dinámicas

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1. Arquitecturas paralelas 66

n  Redes multietapa reconfigurables. n  Se caracterizan porque es posible establecer siempre una

nueva conexión entre un par fuente/destino libres, aunque haya conexiones en curso, pero puede hacerse necesario un cambio en el camino usado por alguna(s) de ellas (reconfiguración).

n  Interesante en procesadores matriciales, en donde se conoce simultáneamente todas las peticiones de interconexión.

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1. Arquitecturas paralelas 67

n  Red de Beneš:

Red de Benes 8 x 8

Redes dinámicas

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1. Arquitecturas paralelas 68

n  La red de Beneš se puede construir recursivamente:

Red de Benes 8 x 8

Red de Benes 4 x 4

Red de Benes 4 x 4

Redes dinámicas

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1. Arquitecturas paralelas 69

n  Redes dinámicas no bloqueantes. n  Se caracterizan porque es posible establecer siempre una

nueva conexión entre un par fuente/destino libres sin restricciones.

n  Son análogas a los conmutadores de barras cruzadas, pero pueden presentar mayor latencia, debido a las múltiples etapas.

Redes dinámicas

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1. Arquitecturas paralelas 70

n  Red de Clos:

1

2

r

1

2

m

1

2

r

n x m r x r m x n

1

n

1

n

Red de Clos

Redes dinámicas